MVME162PA-344E視頻圖畫傳感器在FPGA的操控下進行視頻圖畫信息的搜集，在
收到PC機的搜集指令后MB86S02開端視頻信號的搜集FPGA作為體系的中心操控單元不
僅擔(dān)任視頻圖畫的搜集，并且擔(dān)任視頻圖畫信息的預(yù)處理和體系各單元模塊之間的
數(shù)據(jù)交互。關(guān)于視頻圖畫數(shù)據(jù)量大的特色，為了確保體系的實時性懇求，體系選用
大容量的片外SDRAMR對搜集到的視頻圖畫信息進行緩存，SDRAM操控器由FPGA完結(jié)，
視頻圖畫信息經(jīng)過SDRAM緩存后首要要由FPGA對其進行濾波處理，以消除圖畫信息中
的噪聲攪擾，本體系中選用中值濾波的辦法對搜集到的視頻信息進行處理，濾波后
的數(shù)據(jù)經(jīng)過MVME162PA-344E內(nèi)部FIFO進入DSP進行下一步的緊縮處理。DSP上電后首搶先行引導(dǎo)
程序的自加載，等候FPGA發(fā)送懇求，在收到FPGA的懇求后，DSP樹立EDMA通道從FPGA
獲取視頻數(shù)據(jù)，存滿一幀后，開端對視頻圖畫進行JPEG緊縮處理，緊縮處理后的視
頻圖畫信息經(jīng)過FIFO緩存后，在FPGA的操控下寫入USB接口操控器的數(shù)據(jù)緩存區(qū)，等
待PC機的讀數(shù)懇求，USB接口操控器在收到PC機的讀數(shù)懇求后將數(shù)據(jù)寫入PDIUSBD12
的端口1，以便PC機下一步讀取數(shù)據(jù)。
2 體系軟件全體計劃
體系的軟件計劃根據(jù)硬件構(gòu)造的全體區(qū)分，也能夠分為兩大多數(shù)來描繪。悉數(shù)體系
的作業(yè)如圖2所示，F(xiàn)PGA和DSP各自的程序獨立作業(yè)，經(jīng)過中止信號完結(jié)數(shù)據(jù)的實時
交互。FPGA向DSP方向的指令是經(jīng)過FPGA發(fā)送一個EDMA懇求，DSP經(jīng)過呼應(yīng)EDMA懇求
，樹立EDMA通道，開端從FIFO中進行預(yù)處理后數(shù)據(jù)的讀取，DSP向FPGA傳輸數(shù)據(jù)時，
經(jīng)過向FPGA發(fā)送一個中止信號，讓其從FIFO中把緊縮后的圖畫數(shù)據(jù)讀出來
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